Intelの先端パッケージング技術「EMIB」を支援するEDAツール：DAC 2024で注目（2/2 ページ）

Intelのパッケージング技術「Embedded Multi-Die Interconnect Bridge（EMIB）」は、異種統合マルチチップ／マルチチップレットアーキテクチャの複雑化に対処することを目的とした技術だ。EDAツール大手各社が同技術向けのツールを発表している。

[Majeed Ahmad，EE Times/EDN]

Synopsysはシステムまでの全段階をフォロー

　Synopsysも、DAC 2024の会場でIntel Foundry向けのマルチダイリファレンスフローを披露した。このリファレンスフローはEDAスイート「Synopsys.ai」を搭載し、EMIBアセンブリ技術を使用した高速異種統合のための包括的でスケーラブルなソリューションを設計者に提供することを目的としている。

　2.5Dおよび3Dのマルチダイシステムの統合設計環境である「Synopsys 3DIC Compiler」が実現するリファレンスフローは、シリコンからシステムまでの全ての段階でマルチダイ設計の開発を加速する統合共同設計／解析ソリューションを提供する。さらに、Synopsys 3DIC Compilerとネイティブに統合された「Synopsys 3DSO.ai」は、信号／電力／熱整合性の最適化を実現する。

　現在Synopsysによる買収が進められている電熱ツールサプライヤーのAnsysも、EMIB技術を使用してシリコン貫通ビア（TSV）を必要とせずにダイを柔軟に接続するIntelの2.5Dチップアセンブリ技術向けのマルチフィジックスサインオフソリューションを提供している。同社のEDAプラットフォーム「RedHawk-SC Electrothermal」は、複数のダイを搭載する2.5Dおよび3D ICのマルチフィジックス解析を可能にする。

Cadenceは各段階の移行をサポート

　EDA大手3社のうちの1社であるCadenceも、Intel Foundryと提携して、EMIB技術を活用した統合型先進パッケージングフローを認定し、異種統合マルチチップ／チップレットアーキテクチャの複雑化に対応している。このEMIBフローによって設計者は、異なるフォーマット間でデータを変換することなく、初期段階のシステムレベルのプランニングや最適化、解析からDRC対応の実装や物理的なサインオフにシームレスに移行できる。

Intel アリゾナ工場内の設備［クリックで拡大］ 出所：Intel

　数十年にわたってパッケージング技術の開発をリードしてきたIntelは、複数のダイを1つのパッケージに接続することでシリコン面積を拡大する高度なパッケージング技術の本格量産を開始した。EMIBがパッケージ内で複数のチップを並べて接続するのに対し、「Foveros」ではチップを3D形式で積み重ねる。

　Intelの製品／設計エコシステムイネーブルメント担当バイスプレジデント兼ゼネラルマネジャーを務めるRahul Goyal氏は、「EMIB技術は、従来のスタッキング技術と比較して、マルチダイアセンブリに対する差別化されたアプローチを具現化している」と述べている。Intelは既に「GPU Max」シリーズ（開発コードネーム：Ponte Vecchio）、第4世代のプロセッサ「Xeon」および「Xeon 6」、FPGA「Stratix 10」などの自社チップにEMIB技術を実装している。

　しかし、EMIBは他の高度なパッケージング技術と同様に、マルチダイアーキテクチャの設計とパッケージングの複雑さに関連する新たな課題を提示している。そのため、さまざまなEDAツールをIntelのPADKに組み込むことは、良いスタートとなる。これにより、チップ設計者はEMIB設計を効果的かつ効率的に実装／検証できるようになる。

【翻訳：滝本麻貴、編集：EE Times Japan】