高度なチップレット技術を提供する米新興企業：Eliyan Corporation

近年、チップレットへの関心が高まっている。米スタートアップのEliyan Corporationは、チップレット向けソリューションを提供する企業の一つだ。

[Gary Hilson，EE Times]

　チップレットは近年多くの関心を集めている。そのため、ベストプラクティスの標準化に向けて、最近、「Universal Chiplet Interconnect Express（UCIe）」コンソーシアムが結成された。シリコンバレーのスタートアップ企業であるEliyan Corporation（以下、Eliyan）は現在、ステルスモード（開発状況の詳細を明かさないこと）を脱し、より効率的なパッケージング手法でチップレットエコシステムに貢献できると表明している。

　EliyanのCEO（最高経営責任者）を務めるRamin Farjadrad氏は米国EE Timesのインタビューで、「標準的な有機基板上で同種および異種アーキテクチャを接続する費用対効果の高い方法は非常に必要とされており、Eliyanの高性能チップレットインターコネクトはこのニーズに対応できると考えている」と語った。

　同氏は、「当社のBoW（Bunch-of-Wires）チップレットシステムは、高度なパッケージング技術を使用したダイツーダイ（D2D）の実装と同様の帯域幅と電力効率、レイテンシを、標準的なパッケージで実現できる。これは、高度なパッケージングのあらゆる欠点や制限を取り除いて、大きな可能性への扉を開く技術である」と述べている。

　「ムーアの法則」の終えんは、豊富な並列処理とマルチチップ集積によって実現されるチップレットベースのSiP（System in Package）によって相殺される可能性がある。チップレットベースのSiPは、実装面積が小さく、安価で消費電力が少ないながらも、高い性能を提供できる。

　高効率のハードウェア技術の実現を目指す共同コミュニティーである「Open Compute Project（OCP）」は、Eliyanの「NuLink」PHY（物理層）と特許取得済みの「NuGear 2.5／3D」トポロジーソリューションを含むBoWスキームを採用している。NuLink技術は、UCIeと下位互換性がある。Intelが初期仕様を提供したUCIeは、業界標準規格である「PCI Express（PCIe）」および「Compute Express Link（CXL）」を活用し、D2DのI/O PHYやD2Dプロトコル、ソフトウェアスタックモデルの仕様を定めた規格である。

　Eliyanは特に、さまざまな機能を1つのパッケージに接続する高効率なD2D PHYのニーズに対応するためにBoWアプローチを開発したという。高効率なD2D PHYは、データセンターやクラウドコンピューティング、AI（人工知能）、グラフィックスなどの幅広い計算集約型アプリケーションに必要な性能と統合を実現するために不可欠である。

　同社のNuLink PHY技術は、BoWとUCIeのスーパーセットで、特許取得済みの実装技術を使用してあらゆるパッケージング基板上のD2D接続の電力性能を大幅に差別化するという。加えて、複雑さも軽減して、全体的な開発期間とコストを削減する。

　Farjadrad氏は、「当社のソリューションは、あらゆるチップシステムに適用でき、基本的に高度なパッケージングを必要としない」と述べている。

　NuLinkの導入によって不要となるこれらの高度なパッケージングソリューションには、シリコンインターポーザーや組み込みマルチダイインターコネクトブリッジ（例えばIntelの「EMIB」）などがある。Farjadrad氏は、「例えば、シリコンインターポーザーはシリコンを1個追加する必要があるため、チップを集積できるエリアが制限されてしまう」と説明している。

　これは、性能の制限や、低いウエハーテストカバレッジ（歩留まりに影響する）、TCO（Total Cost of Ownership）の増加、製造サイクル時間の延長につながる可能性があると同氏は述べる。

Eliyanの「Nulink PHY」は、シリコンインターポーザーを排除し、有機基板上で「HBM（High Bandwidth Memory）3」をASICに接続する［クリックで拡大］ 出所：Eliyan Corporation

　また、NuGearでは、DRAMを含むさまざまなプロセスにおいて、異なるD2Dインタフェースのチップを混在させることが可能になる。Eliyanは、初期のバージョンを14nmプロセスで量産し、商用化に耐えうることと、性能上の利点を証明した。最新バージョンは5nmプロセスでテープアウトし、標準的なパッケージにおいて2000Gbps（ビット/秒）/mmのエッジ帯域幅を実現したとしている。

【翻訳：滝本麻貴、編集：EE Times Japan】